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DSP技術(shù)下I2C布局與抗干擾該如何設(shè)計(jì)

2015-06-04 09:55 來源:電源網(wǎng) 編輯:柚子

在智能手機(jī)以及平板電腦的設(shè)計(jì)應(yīng)用方面,基于DSP技術(shù)所設(shè)計(jì)研發(fā)的PCB板是不可缺少的重要組成部分,其中I2C信號(hào)線的整體布線布局和抗干擾能力,能夠直接決定DSP程序指令能否正確發(fā)送并執(zhí)行。我們將通過下文對(duì)I2C布線布局設(shè)計(jì)和抗干擾能力如何增強(qiáng),做進(jìn)一步的介紹和分析。

I2C布線應(yīng)當(dāng)受到足夠的保護(hù)

在通訊領(lǐng)域,I2C信號(hào)線屬于低速控制型信號(hào)線,所以在智能手機(jī)、平板電腦的PCB板設(shè)計(jì)時(shí),工程師僅需要按照一般的控制IO進(jìn)行布線處理即可,無需做特別的保護(hù)設(shè)計(jì),一般情況下不用擔(dān)心I2C受到噪聲源干擾。不過,在一些特定的情況下,比如在進(jìn)行折疊型手機(jī)或平板、滑蓋型手機(jī)的設(shè)計(jì)時(shí),由于I2C信號(hào)線需要通過轉(zhuǎn)軸或滑軌處的FPC,信號(hào)路徑長,與天線的距離也比較近,此時(shí)開漏設(shè)計(jì)輸出級(jí)對(duì)地阻抗加大,所以這種情況下I2C信號(hào)線對(duì)一些電磁干擾波比較敏感,很容易受到RF信號(hào)源的干擾。在這種情況下,工程師需要對(duì)I2C信號(hào)線提供一些有力的保護(hù)措施,例如將I2C的信號(hào)線設(shè)計(jì)成等長度地平行走線,或是在兩邊加地線進(jìn)行保護(hù)以避免臨近層出現(xiàn)高速信號(hào)線等。

上拉電阻應(yīng)安置在OD輸出端附近

上拉電阻的合理設(shè)置,可以對(duì)干擾波進(jìn)行有效的阻擋。通常情況下,如果主從器件兩端均為OD輸出時(shí),上拉電阻應(yīng)當(dāng)放置在信號(hào)路徑的中間位置。如果主設(shè)備端是軟件模擬時(shí)序,而從設(shè)備是OD輸出時(shí),那么工程師需要將電阻安置在靠近從設(shè)備的位置。除此之外,I2C協(xié)議還特別定義了電阻Rs。Rs電阻在該線路中的設(shè)置能夠有效抑制總線上的干擾脈沖進(jìn)入從設(shè)備,提高可靠性。通常情況下,Rs電阻的阻值一般都會(huì)選用100hm—200ohm之間的數(shù)值。當(dāng)然,這個(gè)電阻并不是必須接入的,它更適合在遇到惡劣噪聲環(huán)境的前提下進(jìn)行選用。

除此之外,I2C信號(hào)線上也會(huì)載有一定干擾,這種干擾盡管非常微弱,但同樣也會(huì)影響到FM接收模塊或其他的感應(yīng)功能塊。在遇到這種情況時(shí),工程師可以在靠近FM模塊或觸摸感應(yīng)模塊的信號(hào)線上串接Rs電阻,這樣可以有效降低干擾的影響。同樣的,為了保障抗干擾效果,上拉電阻端的電源也需要進(jìn)行退耦處理。

結(jié)語

通過對(duì)I2C布線的合理規(guī)劃和對(duì)抗干擾能力的提升,PCB板不僅能夠維持正常運(yùn)轉(zhuǎn),也能夠正確快速的執(zhí)行DSP技術(shù)程序指令,整體性能和工作效率可以發(fā)揮到最優(yōu)化狀態(tài)。

標(biāo)簽: DSP技術(shù) I2C 上拉電阻

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