各位大俠指點下，如下電路可否實現升壓？謝謝！
這電路可否實現升壓？
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@major83
知道芯片功能就好說。Toff時，輸出電壓=Vin(DC）+VL(main)+VF，VL(main)=VCC*Nmain/Nvcc，Vcc=Vfb/Rfb_lower*(Rfb_upper+Rfb_lower)，這樣或許可以得到DC+48V的輸出。L（main）是變壓器的主繞組，VF是指整流二極管正向壓降。
謝謝major83,您說Vout=Vin(DC）+VL(main)+VF, 電路設計是想要得到Vl(main)=48V. 可我覺得這推導邏輯是否相反了，FB腳只是檢測主繞組放電完成時，輔助繞組相應得到的拐點電壓，從而控制Vl(main)電壓=48V，而FB腳本身并沒有鉗位功能只有檢測功能。現在問題是Lm放電時是以Vin+48V在放，那輔助繞組得到的電壓就是Vin+48V/Nmain, 這個電壓在FB腳就很容易產生OVP保護了。所以不知道怎么處理？
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@肖樂
謝謝major83,您說Vout=Vin(DC）+VL(main)+VF,電路設計是想要得到Vl(main)=48V. 可我覺得這推導邏輯是否相反了，FB腳只是檢測主繞組放電完成時，輔助繞組相應得到的拐點電壓，從而控制Vl(main)電壓=48V，而FB腳本身并沒有鉗位功能只有檢測功能。現在問題是Lm放電時是以Vin+48V在放，那輔助繞組得到的電壓就是Vin+48V/Nmain,這個電壓在FB腳就很容易產生OVP保護了。所以不知道怎么處理？
PSR的芯片呢，通過FB的采樣電壓判斷輸出電壓，一般是反饋繞組的漏感尖峰過后采樣FB的電壓，再進行調整duty或者頻率。在開關管關閉時，boost變壓器主繞組的電壓VL=Vout-Vin(DC)-Vf，反饋繞組耦合到的電壓=Nvcc/Nmain*VL的。出現FB的OVP現象，可能是芯片的采樣或者芯片內部調整方式不適合做這種拓撲結構，一般Boost拓撲結構的輸出采樣是采樣輸出的DC電壓，這樣做輸出電壓的精度很高（至少比采樣反饋繞組的精度高）。
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http://www.cubesun.cn/bbs/classic/
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@major83
PSR的芯片呢，通過FB的采樣電壓判斷輸出電壓，一般是反饋繞組的漏感尖峰過后采樣FB的電壓，再進行調整duty或者頻率。在開關管關閉時，boost變壓器主繞組的電壓VL=Vout-Vin(DC)-Vf，反饋繞組耦合到的電壓=Nvcc/Nmain*VL的。出現FB的OVP現象，可能是芯片的采樣或者芯片內部調整方式不適合做這種拓撲結構，一般Boost拓撲結構的輸出采樣是采樣輸出的DC電壓，這樣做輸出電壓的精度很高（至少比采樣反饋繞組的精度高）。
謝謝major83,這個電路電路經過多次實驗確定沒辦法實現升壓。該電路
需要加個電解給主繞組提供放電回路，保證主繞組為48V電壓放電。因為該方案是輸出恒壓方案，只有保證放電電壓恒定，芯片FB才不會OVP保護。如果不接那顆電解，放電電壓為Vout-Vin（dc），理論上Vout=Vin(dc)+48V,而實際上輸出接有電解，Vout
不過升壓后帶能力很差，輸出電壓跌得厲害而且PF不高。
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